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安华高用40nm CMOS工艺实现25G SerDes 安华高宣布，已经用40nm CMOS工艺技术实现25Gbps的SerDes。Avago SerDes内核的主要特点在于采用独特的判断反馈均衡(DFE, Decision Feedback Equalization)技术，带来更低的总体功耗和同类产品中最佳的数据延迟、抗噪能力、抖动和串扰表现。 http://www.iccsz.com/site/cn/news/2010/02/26/20100226082426332750.htm 2010/2/27
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安华高用40nm CMOS工艺实现25G SerDes

安华高宣布，已经用40nm CMOS工艺技术实现25Gbps的SerDes。Avago SerDes内核的主要特点在于采用独特的判断反馈均衡(DFE, Decision Feedback Equalization)技术，带来更低的总体功耗和同类产品中最佳的数据延迟、抗噪能力、抖动和串扰表现。

http://www.iccsz.com/site/cn/news/2010/02/26/20100226082426332750.htm 2010/2/27

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